單項(xiàng)選擇題

Moore和Mealy型時(shí)序電路的本質(zhì)區(qū)別是（）

A.沒(méi)有輸入變量
B.當(dāng)時(shí)的輸出只和當(dāng)時(shí)電路的狀態(tài)有關(guān)，和當(dāng)時(shí)的輸入無(wú)關(guān)
C.沒(méi)有輸出變量
D.當(dāng)時(shí)的輸出只和當(dāng)時(shí)的輸入有關(guān)，和當(dāng)時(shí)的電路狀態(tài)無(wú)關(guān)

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單項(xiàng)選擇題

n級(jí)觸發(fā)器構(gòu)成的環(huán)形計(jì)數(shù)器，其有效循環(huán)的狀態(tài)數(shù)為（）

A.n個(gè)
B.2n個(gè)
C.2ⁿ-1個(gè)

單項(xiàng)選擇題

ROM電路由地址譯碼器和存儲(chǔ)體構(gòu)成，若譯碼器有十個(gè)地址輸入線，則最多可有（）個(gè)字。

A.10
B.10²
C.2¹⁰
D.10⁴

Moore和Mealy型時(shí)序電路的本質(zhì)區(qū)別是（）

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n級(jí)觸發(fā)器構(gòu)成的環(huán)形計(jì)數(shù)器，其有效循環(huán)的狀態(tài)數(shù)為（）

ROM電路由地址譯碼器和存儲(chǔ)體構(gòu)成，若譯碼器有十個(gè)地址輸入線，則最多可有（）個(gè)字。

n級(jí)觸發(fā)器構(gòu)成的環(huán)形計(jì)數(shù)器，其有效循環(huán)的狀態(tài)數(shù)為（）

ROM電路由地址譯碼器和存儲(chǔ)體構(gòu)成，若譯碼器有十個(gè)地址輸入線，則最多可有（）個(gè)字。